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Spectrum數字化儀新增SCAPP選項以加速和簡化信號處理[ 11-21 15:39 ]
目前數字化儀所面臨的主要瓶頸來自于使用8核或16核主機中央處理器或是復雜的FPGA(現場可編程門陣列)。Spectrum今日宣布新增用于并行處理的Spectrum CUDA訪問選項(SCAPP)來解決這一問題。
高速ADC板卡QT1125在飛行時間質譜中的應用[ 02-25 10:15 ]
質譜是帶電原子、分子、或分子碎片按質荷比(或質量)的大小順序排列的圖譜。質譜分析法主要是通過對被測樣品離子的質荷比的分析而實現對樣品進行定性和定量的一種分析方法。被分析的樣品首先要離子化,然后利用不同離子在電場或磁場的運動行為的不同,把離子按質荷比(m/z)分開而得到質譜,通過樣品質譜的相關信息,可以得到樣品的定性定量結果。
高速數字化儀的信號處理功能簡介[ 02-14 17:12 ]
高速數字化儀可以實現精確的,高分辨率的數據采集,并傳輸到主機上。在數字化儀和主機上的應用信號處理函數,可以對獲取信號進行增強處理,或者通過簡單測量抽取有用的信息。
高速數據采集卡之PCI總線驅動[ 10-06 09:10 ]
PCI總線是現在非常流行的計算機總線,學會它的驅動設計方法很重要。相信曾經想學習PCI總線驅動的人有這么一個經歷,就是去看那些講解PCI總線驅動的書籍和資料的時候,會被里面繁雜的內容所擊敗,又是什么配置空間又是什么枚舉的,還沒開始真正的去寫PCI的驅動,到這里就已經開始打退堂鼓了。
高速數據采集卡軟件架構[ 09-17 10:25 ]
高速數據采集卡軟件一般分為硬件層、系統層、應用層等。
基于FPGA高速數據采集的IODELAY調整探討[ 09-11 18:58 ]
當今高速AD采樣頻率單片可達幾個G,這樣高的采樣頻率一般是通過多個ADCORE并行分時采集實現的,如此一來,單通道AD采樣率也可上GHz。
基于光纖接口高速數據采集卡[ 09-10 17:04 ]
高速數據采集卡的應用多以高頻模擬信號采集為主,如數百兆帶寬的光電脈沖、中頻信號、數GHz的微波射頻信號、衛星通信信號等。但是模擬信號本地數字化,再經光纖進行遠距離傳輸的應用方式也日漸增多,如數字雷達體制、高速數據中心等的應用。基于光纖接口的高速光纖接收/發送卡也日漸成為大數據傳輸和數字信號處理領域的常備部件。
高速數據采集系統中FPGA復位討論[ 09-04 17:10 ]
在高速數據采集系統中的邏輯設計大多使用FPGA實現。在FPGA設計中,復位設計是必不可少的。復位信號可以使FPGA的各個邏輯單元處于一種已知的狀態。目前,FPGA的復位可以分為異步復位和同步復位。   [email protected](posedgeclk)begin   if(!Rst_n) &
芯片選型心得[ 08-26 17:41 ]
針對TPS7A4700與TPS7A7100   首先我的目的是給AD9912芯片供電,需要3.3V和1.8V的電壓源。現能提供+5V的電壓。將問題轉化成:通過某種芯片將5V電壓轉換成3.3V和1.8V的電壓。   經過資料的搜索后選出兩種芯片可以滿足要求:一種是TPS7A4700一種是TPS7A7100。終是選擇哪一種呢?這就需要仔細的研究其datasheet,看哪一種芯片功能特性更合適。下面我將我的選型方法簡要給大家分享一下。
高速ADC電源設計[ 08-26 17:27 ]
  當今許多應用要求高速采樣模數轉換器(ADC)具有12位或以上的分辨率,以便用戶能夠進行更精確的系統測量。然而,更高分辨率也意味著系統對噪聲更加敏感。系統分辨率每提高一位,例如從12位提高到13位,系統對噪聲的敏感度就會提高一倍。因此,對于ADC設計,設計人員必須考慮一個常常被遺忘的噪聲源——系統電源。ADC是敏感器件,為了實現數據手冊所述的佳額定性能,應當同等看待模擬、時鐘和電源等所有輸入端。噪聲來源眾多,形式多樣,噪聲輻射會影響性能。    
高速ADC測試和評估[ 08-26 17:08 ]
SNR 、SINAD 、差雜散和IMD 均通過類似于圖1 的硬件設置進行測試。在生產測試中,測試硬件均高度集成,但硬件原理都是一樣的。動態測試的基本設置包括一個信號發生器、帶通濾波器、測試夾具、低噪聲電源、編碼源(通常集成于測試板上) 、數據采集模塊和數據分析軟件。坤馳公司提供了相應的應用軟件和硬件,方便其生產的高速采集模塊進行各種性能測試。
PCI高速采集卡設備驅動安裝[ 08-20 17:53 ]
Pci設備驅動安裝,安裝驅動程序時,應確保計算機不與電源連接,要注意板卡防靜電,避免損壞板卡。
高速數據采集系統中FPGA的信號同步策略[ 08-04 17:12 ]
基于FPGA的數字系統設計中大都推薦采用同步時序的設計,也就是單時鐘系統。但是實際的工程中,純粹單時鐘系統設計的情況很少,特別是設計模塊與外圍芯片的通信中,跨時鐘域的情況經常不可避免。
高速ADC PCB布局布線技巧[ 07-17 13:57 ]
在高速模擬信號鏈設計中,印刷電路板(PCB)布局布線需要考慮許多選項,有些選項比其它選項更重要,有些選項則取決于應用。
高速數據采集卡電磁兼容性設計[ 07-04 17:04 ]
1)采用信號接地方式抑制電磁干擾。前級放大電路和末級放大電路的接地設在一個接地點上,抑制了共模阻抗的干擾。接地點的位置選在在保證地線中的電流流向為從小信號電路流向大信號電路,從而避免了大信號電路的地線電流對小信號電路產生干擾。
PCB設計經驗分享[ 06-22 16:04 ]
畫PCB容易出現的問題和需要注意的問題
高速PCIE采集卡在64位系統下的安裝(一)[ 06-04 17:02 ]
64位系統的INF需求 WindowsServer2003SP1和更高的Windows版本不會在x64系統上安裝帶有未修飾INF節的驅動程序包。為了與IntelItanium系統兼容,WindowsServer2003SP1將會安裝帶有未修飾INF節的驅動程序軟件包;但是,INF修飾是Windows硬件徽標計劃的要求,因此帶有未修飾INF節的驅動程序包沒有資格獲得該徽標。
FPGA高速數據采集浮點數定點數轉換[ 06-02 18:04 ]
在FPGA實現數字信號處理過程中經常會遇到將MATLAB程序放到FPGA中去運算,運算完后再導入MATLAB查看數據結果做后續處理。而MATLAB一般為雙精度浮點運算,而FPGA一般為定點運算。所以需要將浮點數轉為定點數,再送到FPGA中去運算,將運算結果導入MATLAB后再轉為浮點數。這就涉及到DSP定標問題。
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